語学力を活かせるのverilog 求人の転職・求人情報

必要な経験・能力等 【必須】■プロセッサの知識(ARM/RISC-V/x86等のアーキテクチャ及びマイクロアーキテクチャ)※命令処理やキャッシュメモリの仕組みについて等、相手に説明ができる方 ■C言語又はアセンブリを用いた組込み開発経験 【歓迎】半導体の基礎知識(pMOS,nMOS,CMOS)、Verilogの知識、FPGAの使用経験 【尚可】■仕様書等の技術英語の読み書きできるレベル【働き方】月平均残業20時間以下、年間休日121日、在宅勤務も相談可能とワークライフバランスも良好です。【当社の強み】上場企業の安定基盤に加え、メーカーと商社の両機能を持つため、ハード・ソフト両面から顧客へワンストップのソリューションを提供可能です。 学歴・資格 学歴：大学院 大学 高専 短大 専修学校 高校 語学力： 資格：

必要な経験・能力等 【歓迎】■FPGA開発（VHDL／Verilog）やマイコン制御経験■高速信号・ノイズ対策などの実務または研究経験■測定器を用いたデバッグ・評価経験■英語で円滑なコミュニケーションが図れる方 【当社転職時の年収アップ事例】■Sier出身（44歳）：550万⇒695万 ■技術者派遣出身（48歳）：490万⇒636万 ■電気制御盤メーカー出身 （35歳）493万⇒627万 【キャリア開発】「ベストマッチングシステム」…業界唯一、受注案件を全エンジニアに公開し自由に検索できるシステム。自らのスキルもインプットされており必要な研修を受けられるため自分の望む仕事へのステップが明確。 学歴・資格 学歴：大学院 大学 高専 短大 専修学校 高校 語学力： 資格：

必要な経験・能力等 【必須】■無線システム技術（アンテナ、信号処理など）または衛星測位技術の知識がある方 【歓迎】■RTKLIB、CLASLIB、PocketSDR、GNSSシミュレータなどの使用経験のある方 ■無線工学、ソフトウェア工学、組込ソフトウェア技術、組込システム技術■ロボット工学、自動制御、計測、電気設計の知識のある方■Python、Matlab/Simulink等のツールによるシミュレーションの経験をお持ちの方■英語の技術書や論文の読解、英会話、英語によるテクニカルライティングの経験のある方 【使用言語、環境、ツール】■使用言語：Python、C、MATLAB、Verilog等■環境ツール：MATLAB/Simulink、RTKLIB等 学歴・資格 学歴：大学院 大学 高専 語学力： 資格：

必要な経験・能力等 【必須】■ＦＰＧＡ論理回路設計経験（１年以上） ■ＦＰＧＡ開発環境の使用経験 ■基本的な電気設計の知識■実機・計測器を用いたデバッグ経験 【尚可】■半導体検査装置またはテスタの実務経験■高速インターフェース知識 【求める人物像】経験の浅い社員とともに熟練社員から積極的に学び、技術継承を推進できる方を求めています。 【当社の強み】２０２４年の賞与実績は７．４２ヶ月分と業界トップクラス。 【働き方】年間休日１２２日（土日祝休み）で、プロジェクトリーダーやスペシャリストとして長期的にキャリア形成が可能です。 学歴・資格 学歴：大学院 大学 高専 短大 専修学校 高校 語学力： 資格：

必要な経験・能力等 【必須】■FPGAまたはデジタル回路設計の実務経験 【歓迎】■FPGA開発・論理設計の経験■Verilog HDL等を使用した開発経験■電源回路設計の経験・知識をお持ちの方は優遇■英語実務経験 【魅力】当社は「東北エリア」を専属に、世界をリードする国家プロジェクトや先端開発領域における技術支援事業を展開しております。各業界最大手メーカーを中心とした取引実績を誇ることで、他に類のない『ハイクラス』なエンジニアリング企業の地位を確立しています。 【待遇】快適な労働環境の実現を目指し、「残業平均15h」「家賃補助60％」「セミナー受講支援」など、多数の福利厚生をご用意しています。 学歴・資格 学歴：大学院 大学 高専 短大 専修学校 高校 語学力： 資格：

必要な経験・能力等 【MUST】■Verilogを使用したロジック設計検証の経験■測定向けテストパターン(WGL等)作成経験 【WANT】 ■ExcelVBAによるExcelのマクロ作成、あるいは、Python を使用したデータ処理プログラミング ■実機評価環境を使用した評価、デバッグ経験 ■LSI Tester のオペレーション経験 ■英語のドキュメント作成経験 学歴・資格 学歴：大学院 大学 高専 短大 専修学校 高校 語学力： 資格：

必要な経験・能力等 【必須】■LSI論理検証(ASIC, SOC, FPGA問わず)の経験 5年以上 ■Verilog-HDL使用経験 5年以上 ■Linux環境での検証経験がある 【働き方】残業時間は月20H程、有給取得率72.6%、年間休日123日と働きやすい環境です。2023年度から等級制度を取り入れ、適切な評価ができるようになり、スキル・頑張りに応じて給与をあげられる仕組みに変更。定着率も向上し、長期就労しやすい環境に変革しています。 【風土】社内用チャットアプリがあり、気軽に相談できる風土。サークル活動も活発で風通しの良い社風です。 https://www.ostech-online-magazine.com/ 学歴・資格 学歴：大学院 大学 高専 短大 専修学校 高校 語学力： 資格：

必要な経験・能力等 【必須】■無線システム技術（アンテナ、信号処理など）または衛星測位技術の知識がある方 【歓迎】■RTKLIB、CLASLIB、PocketSDR、GNSSシミュレータなどの使用経験のある方 ■無線工学、ソフトウェア工学、組込ソフトウェア技術、組込システム技術■ロボット工学、自動制御、計測、電気設計の知識のある方■Python、Matlab/Simulink等のツールによるシミュレーションの経験をお持ちの方■英語の技術書や論文の読解、英会話、英語によるテクニカルライティングの経験のある方 【使用言語、環境、ツール】■使用言語：Python、C、MATLAB、Verilog等■環境ツール：MATLAB/Simulink、RTKLIB等 学歴・資格 学歴：大学院 大学 高専 語学力： 資格：

必要な経験・能力等 【必須】■デジタル論理回路設計 4年以上（特に映像入出力系の開発経験があれば尚可）■Verilog-HDLでの開発経験 ■英語の規格書や設計情報を確認できる英語レベル 【歓迎】■プロジェクトリーダー経験（少人数でも可） ■Automotive SPICEなど車載品質設計業務経験 ■FPGAを用いた設計開発経験 ■映像アルゴリズムの知識■機能安全/セキュリティの知識 ■組み込みソフトウェアの知識 【求める人物像】■コミュニケーションが苦手でない方 ■論理的に物事を考えられる方 【働き方】■フルフレックス制、リモートワーク可、年間休日127日、副業も可能と柔軟な働き方を実現できる社風です！ 学歴・資格 学歴：大学院 大学 高専 語学力：英語 資格：

必要な経験・能力等 【必須】・デジタル回路設計経験（RTL設計、論理設計など） ・SystemVerilog／Verilog HDLによる設計経験 ・検証・評価の実務経験 ・英語ドキュメントを読解できる 【働き方】残業時間は月20H程、有給取得率72.6%、年間休日123日と働きやすい環境です。2023年度から等級制度を取り入れ、適切な評価ができるようになり、スキル・頑張りに応じて給与をあげられる仕組みに変更。定着率も向上し、長期就労しやすい環境に変革しています。 【風土】社内用チャットアプリがあり、気軽に相談できる風土。サークル活動も活発で風通しの良い社風です。 https://www.ostech-online-magazine.com/ 学歴・資格 学歴：大学院 大学 高専 短大 専修学校 高校 語学力：英語 資格：

必要な経験・能力等 【必須】HDL（Verilog／SystemVerilog等）による回路設計に関する知識または経験 ★FPGAの経験が浅い方も歓迎。、育成前提で幅広く選考します。 【ポジションの魅力】 私たちは半導体業界のトッププレイヤーとして、世界最先端の試験装置開発に取り組んでいます。半導体テスタの心臓部となる制御回路を担い、仕様策定から設計・検証・評価まで一気通貫で関われるポジションです。FPGA設計に加え、システムバスや組込みソフトまで領域を広げられ、製品性能向上に直結する手応えを実感できます。 学歴・資格 学歴：大学院 大学 高専 語学力：英語 資格：

必要な経験・能力等 【必須】■Verilog HDLを用いた論理設計・検証経験 【歓迎】■チームマネジメント(数名)、英文のReading/Writing (TOEIC600点程度) 【メイテックには自己成長を促す仕組みがあります】 受注案件の全てがネット上で検索可能な「ベストマッチングシステム」を 独自に保有しており、ご自身のキャリアに照らし、ぴったりの案件、 もう一歩頑張れば就ける案件などを探すことができます。また、希望する 受注案件にスキルが不足している場合はそのスキルが赤字で表示される 仕組みとなっており、足りないスキルは研修で補うことが可能です。 学歴・資格 学歴：大学院 大学 高専 短大 専修学校 高校 語学力： 資格：

必要な経験・能力等 【必須要件（すべて必須）】■RTL設計経験 ■デジタル回路設計経験 ■設計業務のリーダー経験（規模問わず） ■大規模LSI(SoC)開発に興味・やる気のある方 【歓迎要件】 □高速 I/F IP(PCIe/Ethernet/USB等)の開発経験のある方 □アーキテクチャ設計経験 □部門間におけるコミュニケーションに抵抗のない方(業務調整・交渉) □英語での業務経験 学歴・資格 学歴：大学院 大学 語学力： 資格：

必要な経験・能力等 【必須】■Verilogを用いた論理設計及びテストベンチの経験■IPを用いた論理設計（デジタル）が3年以上■PrimeTIME 【歓迎】■FPGAのIPや論理設計■英語に対しての苦手意識がない 【メイテックには自己成長を促す仕組みがあります】 受注案件の全てがネット上で検索可能な「ベストマッチングシステム」を独自に保有しており、ご自身のキャリアに照らし、ぴったりの案件、もう一歩頑張れば就ける案件などを探すことができます。また、希望する受注案件にスキルが不足している場合はそのスキルが赤字で表示される仕組みとなっており、足りないスキルは研修で補うことが可能です。 学歴・資格 学歴：大学院 大学 高専 短大 専修学校 高校 語学力： 資格：

必要な経験・能力等 【必須】LSI/FPGAのデジタル回路設計経験（Verilog・VHDLでの設計・検証経験） 【歓迎】 ■画像処理回路の設計経験■車載向けLSIの設計経験 ■高速IFを搭載したLSIやFPGAの設計経験■英語スキルがある方 【入社後】先輩OJTで当社の検証手法を習得し、徐々に主担当へステップUP！ 学歴・資格 学歴：大学院 大学 高専 語学力： 資格：

必要な経験・能力等 【必須】■Verilogを用いた論理設計及びテストベンチの経験 ■IPを用いた論理設計（デジタル）が3年以上 【歓迎】■FPGAのIPや論理設計■英語に対しての苦手意識がない方 【顧客から当社への期待】新規PJ開始における増員 学歴・資格 学歴：大学院 大学 高専 短大 専修学校 高校 語学力： 資格：

必要な経験・能力等 【必須】■Verilog HDLを用いた論理設計・検証経験 【歓迎】■チームマネジメント経験(数名) ■英文のReading/Writing (TOEIC600点程度) 【メイテックには自己成長を促す仕組みがあります】 受注案件の全てがネット上で検索可能な「ベストマッチングシステム」を 独自に保有しており、ご自身のキャリアに照らし、ぴったりの案件、 もう一歩頑張れば就ける案件などを探すことができます。また、希望する 受注案件にスキルが不足している場合はそのスキルが赤字で表示される 仕組みとなっており、足りないスキルは研修で補うことが可能です。 学歴・資格 学歴：大学院 大学 高専 短大 専修学校 高校 語学力： 資格：

必要な経験・能力等 【必須】■プロジェクトマネジメント経験■Verilogを用いた論理設計及びテストベンチの経験■IPを用いた論理設計（デジタル）が3年以上■PrimeTIME 【歓迎】■FPGAのIPや論理設計■英語に対して苦手意識がない 【メイテックには自己成長を促す仕組みがあります】 受注案件の全てがネット上で検索可能な「ベストマッチングシステム」を独自に保有しており、ご自身のキャリアに照らし、ぴったりの案件、もう一歩頑張れば就ける案件などを探すことができます。また、希望する受注案件にスキルが不足している場合はそのスキルが赤字で表示される仕組みとなっており、足りないスキルは研修で補うことが可能です。 学歴・資格 学歴：大学院 大学 高専 短大 専修学校 高校 語学力： 資格：

必要な経験・能力等 【必須】Verilog HDLを用いた論理設計・検証経験 【歓迎】チームマネジメント経験(数名)、英文のReading/Writing (TOEIC600点程度) ＊休日面接も可能ですので、興味をお持ちの方はご応募ください 【生涯プロエンジニア】1社・1製品に縛られることなく、約1400社の取引先の中から多様な先端開発や上流工程に携わることができます。次の10年も技術者として最前線で市場価値を高め続けられる環境が整っており、技術力に応じた給与制度の為、経験を積み昇給を目指すことも可能です。役職定年はなく400名以上のエンジニアが定年到達後も活躍。 培ってきた経験を活かし、時代の変化に応える当社で新たな挑戦をしてみませんか？ 学歴・資格 学歴：大学院 大学 高専 短大 専修学校 高校 語学力： 資格：

必要な経験・能力等 【必須】■プログラム言語によるデバイス制御ソフトウエア開発経験（C／C++いずれか）■マイコン制御、リアルタイムOS（RTOS）の知識・経験 【歓迎】■SPI/I2C/UARTなどの通信プロトコル実装経験 ■英語による技術文書読解力（海外ベンダーとのやり取りが発生します） 【当社の強み】当社はロケット等と同じくらいの精密さが求められる産業向け印刷機械を製造しているほか、国内で1社、世界でも2社のみの紙幣印刷機の製造を行っております。デジタル印刷機の更なる性能向上のため、国内トップシェアを誇る高い技術力のもと設計開発業務ができるのは当社ならではです。 学歴・資格 学歴：大学院 大学 語学力： 資格：

必要な経験・能力等 【必須】 ■組込みソフトウェア開発経験 ■FPGAコーディングおよびデバッグ経験 ■C言語またはVerilog/VHDLを用いた開発経験 ■英文マニュアルの読解が可能な英語力（TOEIC600点程度目安） 学歴・資格 学歴：大学院 大学 高専 短大 専修学校 高校 語学力：英語 資格：

必要な経験・能力等 【必須】 ・回路設計(アナログ/デジタル)or評価の実務経験1年以上 【選考フロー】 応募～内定まで最短2週間。土曜日、平日夜の選考も一部調整可能です。 1,応募(書類選考) 2,一次選考(採用担当面接・会社説明) 3,最終選考(役職者面接、オンライン筆記試験) 4,内定 学歴・資格 学歴：大学院 大学 高専 短大 専修学校 高校 語学力： 資格：

必要な経験・能力等 【必須】CMOS回路設計の実務経験、または半導体回路に関する同等の知識・経験をお持ちの方。 【歓迎】 ・アナログ回路（ADC／DAC、PLL、電源、センサーIF等）またはデジタル回路設計の経験 ・SPICE、Verilog／VHDL／SystemVerilog等を用いた設計・検証経験 ・レイアウト設計、寄生抽出、PVT／モンテカルロ解析の経験 ・試作評価、測定機器を用いた解析経験 学歴・資格 学歴：大学院 大学 語学力：英語 資格：