求める人材:  【必要スキル・経験】  以下のような実務経験をお持ちの 即戦力エンジニアを募集しています！  ■設計ツール CADENCE Virtuoso Layout Editor XL を使いこなせる方  ■検証ツール Calibre (DRC/LVS/ERC) および CADENCE RVE での 検証プロセスがわかる方  ■OS/操作環境 Unix/Linux上でのコマンド操作（ファイル管理等）ができる方  ■PCスキル Officeソフト （Excelでの集計、PowerPoint・Wordでの資料作成、Outlookでの調整）  ■専門知識 半導体デバイスが「どう動き、どんな機能を持つか」 という基本原理を理解している方  ※ブランクがある方も歓迎します。まずはご相談ください。  ーーーーーーーーーーーーーーーーーーーーーー  【歓迎スキル】 ■LSIの全体的なレイアウト設計、 または製品の評価・実測経験 ■車載向けなどの 「機能安全設計・評価」に関する知見 ■Microsoft Visio を用いた 構成図の作成スキル

半導体のPDK開発・検証エンジニア/20代~50代活躍中!/日勤のみ

【日勤のみ×土日祝休み】経験者必見！アナログレイアウトのスペシャリスト急募！

求める人材:  【必須スキル】 以下の「いずれか」に該当する方 （目安：3年程度の実務経験）  ■ RTL設計経験 （Verilog HDL/SystemVerilog） ■ 論理検証・EDA検証経験 ■ DFTツール使用経験 （MBIST/SCAN/BSDL等） ■ STA（タイミング解析）経験 ■ SystemVerilog/C言語での テストベンチ開発経験  ※ブランクがある方も歓迎します。 まずはご相談ください。  【歓迎スキル】 ■ Linux CUI環境での開発経験 ■ UVM/OVMを用いた検証環境構築経験 ■ FPGAプロトタイピング経験 ■ 低消費電力設計の知識・経験 ■ ASIC/SoCの開発プロジェクト経験 ■ チームリード・マネジメント経験 ■ 英語でのドキュメント読解力

半導体のデジタル回路設計・検証スタッフ/20代〜50代活躍中!

【経験者必見◎オープンポジション！】日勤のみ・土日祝休みでライフワークバランス充実♪

求める人材:  【必須スキル】  ■RTL検証の実務経験がある ■C言語コーディング経験がある ■SystemVerilogコーディング経験がある ■UVM検証環境構築の経験がある ■VIP活用経験がある  ※ブランクがある方も歓迎します！ まずはご相談ください。

半導体デジタル回路検証スタッフ(チップトップ)/経験者必見/年間休日125日!

日勤のみ×土日祝休み◎ 20代〜50代活躍中！経験を活かせる！年収600万円以上の高収入◎

求める人材:  【必須スキル】 ■Verilogの読み書きが出来る ■論理回路の設計・検証の経験 ■LinuxまたはUnix環境での開発経験 ■Unix/Linux コマンドを扱えること  ※ブランクがある方も歓迎します。 まずはご相談ください！  【歓迎スキル】 NCVerilog,SpyGlassの使用経験

【経験者歓迎!】半導体のデジタル回路設計・検証スタッフ/年間休日125日

日勤のみ・土日祝休みでライフワークバランス充実♪20代〜50代まで幅広い世代が活躍中◎

求める人材:  〜ブランクOK・UIターン歓迎〜  【必要スキル・経験】 ■一連の設計実務経験 フロアプランから、自動配置配線、 タイミング・物理FIXまでを完遂した経験  ■EDAツールの使用経験（以下のいずれか一方で可） Cadence系：Innovus / Soc Encounter Synopsys系：FusionCompiler / ICC2 / ICCompiler  ※ブランクがある方も歓迎します。 まずはご相談ください！  【歓迎スキル】 ■トラブルシューティング能力 タイミングレポートからエラー（Violation）の 原因を分析し、 自ら改善策を提案・実行できる  ■検証ツールの使用経験 Calibre または ICV を使用した レイアウト物理検証の経験がある

半導体プロセス設計、職場見学可、契約社員の転職・求人情報

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半導体のデジタル回路設計・検証スタッフ/20代〜50代活躍中!

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